题目内容：
一个能为VHDL综合器接受，并能作为一个独立的设计单元的完整的VHDL程序称为选项
A:设计输入
B:设计输出
C:设计实体
D:设计结构
参考答案：
选择题：一个能为VHDL综合器接受，并能作为一个独立的设计单元的完整的VHDL程序称为选项A:设计输入B:设
- 题目分类：DSP原理及应用
- 题目类型：选择题
- 查看权限：VIP
选项
A:设计输入
B:设计输出
C:设计实体
D:设计结构
选项
A:设计输入
B:设计输出
C:设计实体
D:设计结构
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